北理工可编程逻辑器件实验报告.docx
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1、 本科实验报告实验名称: 可编程逻辑器件实验报告 课程名称:可编程逻辑器件实验时间:任课教师:实验地点:实验教师:实验类型: 原理验证 综合设计 自主创新学生姓名:学号/班级:组 号:学 院:同组搭档:专 业:成 绩:9999计数器一、实验目的编程实现一个含清零功能9999计数器,并用7段数码管显示。二、实验器材EPM7128STC100-15,计算机三、实验过程(1)原理分析a、分频要实现一个0-9999计数器,并且肉眼可观,但是EPM7128STC100-15系统只有一个6M的时钟,频率太高,肉眼不可见,因此得用一个分频器将系统时钟降下来。本实验用了6个74LS190 BCD计数器级联,可
2、实现1000000分频,从而将系统时钟变为6HZ。b、计数系统分频之后,接下来实现计数,仍然用74LS190 BCD计数器4个级联实现09999的计数功能,将每个计数器的管脚输出。c、扫描实验要求用4个7段数码管输出,计数输出是4个二进制数,因此本步骤的功能是将每个二进制数对应于一个7段数码管,再把单片机系统的时钟(6M Hz)作为扫描的时钟,从而实现4个7段数码管同步显示。d、译码计数输出的是00001001二进制形式的数,而7段数码管是abcdefg七段数码管,要实现这两个的连接,需要一个译码器,来将这四个数同步的显示在七段数码管上。(2)程序及图形设计a、分频和计数 图形设计如下:画好上
3、面的图以后编译后再将上面的设计为一整个芯片,如下图所示:b、扫描 代码:-*LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;USE IEEE.STD_LOGIC_ARITH.ALL;USE IEEE.STD_LOGIC_UNSIGNED.ALL;-*ENTITY Scaner isPORT(rst: instd_logic;- System RSTclk: in std_logic;- System Clocka,b,c,d: instd_logic_vector(3 downto 0);o_data: outstd_logic_vector(3 downto
4、 0);o_comm: outstd_logic_vector(3 downto 0)- disp bit ctrl);END Scaner;-*architecture action of Scaner istype s_type is(LED0,LED1,LED2,LED3);signal s_LED : s_type; - State Signal Declarebeginprocess(clk,rst)beginif rst = 0 theno_comm= 1111;o_data= 1111;s_LEDo_comm= 1110;o_data= d;s_LEDo_comm= 1101;o
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