芯片延迟测试PPT课件.ppt
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1、芯片延迟测试 报告人:陈思 导师:余国义1.主要内容芯片延迟测试的重要性芯片延迟测试的目的芯片延迟的故障模型芯片延迟的测试方法芯片延迟测试施加方法2.芯片延迟测试的重要性:电路速度越来越高;缺陷数目随着特征尺寸不断下降而剧增,延迟超出给定设计时间范围的几率就增大3.芯片延迟测试的目的验证被测电路在给定的电压和温度范围内的时间信息确认被测电路符合设计规格4.芯片延迟的故障模型门延迟故障路径延迟故障门传输延迟故障互连传播延迟故障惯性延迟故障最大最小延迟故障5.门延迟故障模型GDF:该模型假定逻辑门的延迟是从门的输入端到输出端的,门的上升延迟时间和下降延迟时间可以不同,延迟可以从不同的门输入到不同的
2、门输出,且假定互连延迟已累积到门延迟内。门故障模型是假定延迟故障源于有故障的门,可分为转换故障和小门延迟故障(沿最长的延迟路径作的测试,工业界应用很少)。转换故障TF 假定门延迟聚于门的输入输出端(也称门端聚集延迟故障),分为上升延迟故障STR和下降延迟故障STL,分别描述门对上升和下降信号的延迟时间长。如图与非门上升延迟故障时序图6.GDF模型的优点:模型简单,易于处理,不足是未考虑其他门的延迟积累效应和忽略了连线的延迟。例:如图多路选择器7.路径延迟故障模型PDF:用来描述信号传播路径上某些导通的晶体管、扩散造成的缺陷和互连线等,导致信号延迟超出了额定的时间间隔,PDF考虑了从原始输入到输
3、出的积累延迟。PDF可分为鲁棒测试和非鲁棒测试。门传输延迟:门电路内部传输信号时从一个输入到输出所造成的延迟,不考虑互连延迟。惯性延迟:也称转换延迟,为门输出转换时间与门输入转换时间之差,其值与输入电容、器件参数和输出电容有关,也与输入上升时间或下降时间以及其他输入的影响有关。最大最小延迟:根据工艺参数的变化范围所提取的最大和最小延迟时间,没考虑门延迟和互联延迟的关联情况。8.芯片延迟的测试方法随机测试功能测试结构性测试9.10.随机测试:在额定的时钟频率下把随机测试图形施加给被测电路,优点是可以采用片内BIST电路,以电路运行速度进行实速测试,且可检测出没建模的故障,缺点是对长路径的覆盖率低
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